上下拉電阻的作用：

1、當TTL電路驅動COMS電路時，如果TTL電路輸出的高電平低於COMS電路的最低高電平（一般為3.5V）， 這時就需要在TTL的輸出端接上拉電阻，以提高輸出高電平的值。

2、OC閘電路必須加上拉電阻，以提高輸出的搞電平值。

3、為加大輸出引腳的驅動能力，有的微控制器管腳上也常使用上拉電阻。

4、在COMS晶片上，為了防止靜電造成損壞，不用的管腳不能懸空，一般接上拉電阻產生降低輸入阻抗，提供洩荷通路。

5、晶片的管腳加上拉電阻來提高輸出電平，從而提高晶片輸入訊號的噪聲容限增強抗干擾能力。

6、提高匯流排的抗電磁干擾能力。管腳懸空就比較容易接受外界的電磁干擾。

7、長線傳輸中電阻不匹配容易引起反射波干擾，加上下拉電阻是電阻匹配，有效的抑制反射波干擾。 上拉電阻阻值的選擇原則包括: 1、從節約功耗及晶片的灌電流能力考慮應當足夠大；電阻大，電流小。 2、從確保足夠的驅動電流考慮應當足夠小；電阻小，電流大。 3、對於高速電路，過大的上拉電阻可能邊沿變平緩。 綜合考慮以上三點,通常在1k到10k之間選取。對下拉電阻也有類似道理。 上拉電阻實際上是集電極輸出的負載電阻。不管是在開關應用和模擬放大，此電阻的選則都不是拍腦袋的。工作線上性範圍就不多說了，在這裡是討論的是電晶體是開關應用，所以只談開關方式。找個TTL器件的資料單獨看末級就可以了，內部都有負載電阻根據不同驅動能力和速度要求這個電阻值不同，低功耗的電阻值大，速度快的電阻值小。但晶片製造商很難滿足應用的需要不可能同種功能晶片做許多種，因此乾脆不做這個負載電阻，改由使用者自己自由選擇外接，所以就出現OC、OD輸出的晶片。由於數字應用時電晶體工作在飽和和截止區，對負載電阻要求不高，電阻值小到只要不小到損壞末級電晶體就可以，大到輸出上升時間滿足設計要求就可，隨便選一個都可以正常工作。但是一個電路設計是否優秀這些細節也是要考慮的。集電極輸出的開關電路不管是開還是關對地始終是通的，電晶體導通時電流從負載電阻經導通的電晶體到地，截止時電流從負載電阻經負載的輸入電阻到地，如果負載電阻選擇小點功耗就會大，這在電池供電和要求功耗小的系統設計中是要儘量避免的，如果電阻選擇大又會帶來訊號上升沿的延時，因為負載的輸入電容在上升沿是透過無源的上拉電阻充電，電阻越大上升時間越長，下降沿是透過有源電晶體放電，時間取決於器件本身。因此設計者在選擇上拉電阻值時，要根據系統實際情況在功耗和速度上兼顧.

上下拉電阻的作用：

1、當TTL電路驅動COMS電路時，如果TTL電路輸出的高電平低於COMS電路的最低高電平（一般為3.5V）， 這時就需要在TTL的輸出端接上拉電阻，以提高輸出高電平的值。

2、OC閘電路必須加上拉電阻，以提高輸出的搞電平值。

3、為加大輸出引腳的驅動能力，有的微控制器管腳上也常使用上拉電阻。

4、在COMS晶片上，為了防止靜電造成損壞，不用的管腳不能懸空，一般接上拉電阻產生降低輸入阻抗，提供洩荷通路。

5、晶片的管腳加上拉電阻來提高輸出電平，從而提高晶片輸入訊號的噪聲容限增強抗干擾能力。

6、提高匯流排的抗電磁干擾能力。管腳懸空就比較容易接受外界的電磁干擾。

7、長線傳輸中電阻不匹配容易引起反射波干擾，加上下拉電阻是電阻匹配，有效的抑制反射波干擾。 上拉電阻阻值的選擇原則包括: 1、從節約功耗及晶片的灌電流能力考慮應當足夠大；電阻大，電流小。 2、從確保足夠的驅動電流考慮應當足夠小；電阻小，電流大。 3、對於高速電路，過大的上拉電阻可能邊沿變平緩。 綜合考慮以上三點,通常在1k到10k之間選取。對下拉電阻也有類似道理。 上拉電阻實際上是集電極輸出的負載電阻。不管是在開關應用和模擬放大，此電阻的選則都不是拍腦袋的。工作線上性範圍就不多說了，在這裡是討論的是電晶體是開關應用，所以只談開關方式。找個TTL器件的資料單獨看末級就可以了，內部都有負載電阻根據不同驅動能力和速度要求這個電阻值不同，低功耗的電阻值大，速度快的電阻值小。但晶片製造商很難滿足應用的需要不可能同種功能晶片做許多種，因此乾脆不做這個負載電阻，改由使用者自己自由選擇外接，所以就出現OC、OD輸出的晶片。由於數字應用時電晶體工作在飽和和截止區，對負載電阻要求不高，電阻值小到只要不小到損壞末級電晶體就可以，大到輸出上升時間滿足設計要求就可，隨便選一個都可以正常工作。但是一個電路設計是否優秀這些細節也是要考慮的。集電極輸出的開關電路不管是開還是關對地始終是通的，電晶體導通時電流從負載電阻經導通的電晶體到地，截止時電流從負載電阻經負載的輸入電阻到地，如果負載電阻選擇小點功耗就會大，這在電池供電和要求功耗小的系統設計中是要儘量避免的，如果電阻選擇大又會帶來訊號上升沿的延時，因為負載的輸入電容在上升沿是透過無源的上拉電阻充電，電阻越大上升時間越長，下降沿是透過有源電晶體放電，時間取決於器件本身。因此設計者在選擇上拉電阻值時，要根據系統實際情況在功耗和速度上兼顧.