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  • 1 # mtglo16099

    設計思路由於譯碼器譯碼輸入與輸出對應,輸入端位0000~1111對應選擇輸出端的Q0~Q15,且0000~0111恰好對應Q0~Q7,故可以根據輸入端最高位將4-16線譯碼器分割為低8位和高8位,結合邏輯地址分段的思路使用兩個3-8線譯碼器的表示對應的Q0~Q7和Q8~Q15。由於Q0~Q7和Q8~Q15除了輸入端的最高位不同其餘位數對應相等,因此可以透過使用輸入端最高位控制3-8譯碼器的使能端來選擇輸出埠的段地址,透過剩餘的輸入作為偏移地址控制有效譯碼器的輸出。設計分析該設計透過輸入端最高位作為片選訊號作為分段的選擇,將輸入端剩餘位數作為偏移量選擇片內輸出,實現兩個3-8譯碼器的級聯形成4-16譯碼器。注意事項譯碼器根據其內部結構不同輸出端和使能端均有高電平有效和低電平有效兩種,實際使用應根據相關技術手冊調整,即調整反相器的位置和輸出的預設電平,常使用上拉電阻和下拉電阻。先取第1片74LS138的和作為它的第四個地址輸入端(在同一個時間令),再取第2片74LS138的和作為它的第四個地址輸入端(在同一個時間令),最後取兩片的和,並將兩片74LS138相接,於是得到兩片74LS138的輸出分別為:這樣就用兩個3線-8線譯碼器74LS138擴充套件成一個4線-16線的譯碼器了,電路原理圖如下圖所示:74LS138 為3線-8線譯碼器,共有 54LS138和 74LS138 兩種線路結構型式。其中,54LS138為軍用,74LS138為民用。其工作原理為:2、利用 E1、E2和E3可級聯擴充套件成 24 線譯碼器;若外接一個反相器還可級聯擴充套件成 32 線譯碼器。3、若將選通端中的一個作為資料輸入端時,74LS138還可作資料分配器。4、可用在8086的譯碼電路中,擴充套件記憶體。

  • 2 # mtglo16099

    設計思路由於譯碼器譯碼輸入與輸出對應,輸入端位0000~1111對應選擇輸出端的Q0~Q15,且0000~0111恰好對應Q0~Q7,故可以根據輸入端最高位將4-16線譯碼器分割為低8位和高8位,結合邏輯地址分段的思路使用兩個3-8線譯碼器的表示對應的Q0~Q7和Q8~Q15。由於Q0~Q7和Q8~Q15除了輸入端的最高位不同其餘位數對應相等,因此可以透過使用輸入端最高位控制3-8譯碼器的使能端來選擇輸出埠的段地址,透過剩餘的輸入作為偏移地址控制有效譯碼器的輸出。設計分析該設計透過輸入端最高位作為片選訊號作為分段的選擇,將輸入端剩餘位數作為偏移量選擇片內輸出,實現兩個3-8譯碼器的級聯形成4-16譯碼器。注意事項譯碼器根據其內部結構不同輸出端和使能端均有高電平有效和低電平有效兩種,實際使用應根據相關技術手冊調整,即調整反相器的位置和輸出的預設電平,常使用上拉電阻和下拉電阻。先取第1片74LS138的和作為它的第四個地址輸入端(在同一個時間令),再取第2片74LS138的和作為它的第四個地址輸入端(在同一個時間令),最後取兩片的和,並將兩片74LS138相接,於是得到兩片74LS138的輸出分別為:這樣就用兩個3線-8線譯碼器74LS138擴充套件成一個4線-16線的譯碼器了,電路原理圖如下圖所示:74LS138 為3線-8線譯碼器,共有 54LS138和 74LS138 兩種線路結構型式。其中,54LS138為軍用,74LS138為民用。其工作原理為:2、利用 E1、E2和E3可級聯擴充套件成 24 線譯碼器;若外接一個反相器還可級聯擴充套件成 32 線譯碼器。3、若將選通端中的一個作為資料輸入端時,74LS138還可作資料分配器。4、可用在8086的譯碼電路中,擴充套件記憶體。

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